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章节进度

章 标题 讲义 图片 练习 学习状态 最近更新
0 零基础起步：怎样读数字电路 正文完成 4 张 SVG 8 题及答案 待审核 2026-08-29
1 数字信号、抽象层次与学习地图 正文完成 5 张 SVG 10 题及答案 待审核 2026-08-27
2 MOSFET 的数字开关模型 正文完成 5 张 SVG 11 题及答案 待审核 2026-08-27
3 CMOS 反相器的静态特性 正文完成 5 张 SVG 12 题及答案 待审核 2026-08-27
4 CMOS 反相器的动态特性与功耗 正文完成 5 张 SVG 13 题及答案 待审核 2026-08-27
5 静态 CMOS 逻辑门 正文完成 5 张 SVG 14 题及答案 待审核 2026-08-27
6 数制、编码与逻辑表示 正文完成 5 张 SVG 15 题及答案 待审核 2026-08-27
7 布尔代数与逻辑化简 正文完成 5 张 SVG 15 题及答案 待审核 2026-08-27
8 组合逻辑模块 正文完成 6 张 SVG 16 题及答案 待审核 2026-08-27
9 二进制算术电路 正文完成 6 张 SVG 17 题及答案 待审核 2026-08-27
10 组合逻辑的时序行为 正文完成 6 张 SVG 18 题及答案 待审核 2026-08-27
11 从反馈到存储：锁存器 正文完成 6 张 SVG 18 题及答案 待审核 2026-08-28
12 触发器与寄存器 正文完成 6 张 SVG 19 题及答案 待审核 2026-08-28
13 计数器与简单时序模块 正文完成 6 张 SVG 20 题及答案 待审核 2026-08-28
14 同步时序设计与时序约束 正文完成 6 张 SVG 21 题及答案 待审核 2026-08-28
15 时钟偏斜、抖动与亚稳态 正文完成 6 张 SVG 22 题及答案 待审核 2026-08-28
16 有限状态机 正文完成 6 张 SVG 23 题及答案 待审核 2026-08-28
17 数据通路与控制器 正文完成 6 张 SVG 24 题及答案 待审核 2026-08-28
18 存储器基础 正文完成 6 张 SVG 25 题及答案 待审核 2026-08-28
19 Verilog/SystemVerilog 的硬件表达 正文完成 6 张 SVG 26 题及答案 待审核 2026-08-28
20 仿真、测试平台与基础验证 正文完成 6 张 SVG 27 题及答案 待审核 2026-08-29
21 综合与静态时序分析基础 正文完成 6 张 SVG 28 题及答案 待审核 2026-08-29
22 标准单元与物理实现流程 正文完成 6 张 SVG 29 题及答案 待审核 2026-08-29
23 功耗、可测试性与完整设计复盘 正文完成 6 张 SVG 30 题及答案 待审核 2026-08-29

阶段复习

阶段 覆盖内容 状态 得分/结果 待加强内容
一 第 1～5 章 材料完成，待作答 — 完成综合测验后按错题类别记录
二 第 6～10 章 材料完成，待作答 — 完成 4 bit ALU 纸面设计后按错题类别记录
三 第 11～16 章 材料完成，待作答 — 完成定时控制器后按错题类别记录
四 第 17～21 章 材料完成，待作答 — 完成 8 字累加器纸面设计后按错题类别记录
结课 第 1～23 章 材料完成，待作答 — 完成结课综合测验与贯穿式项目后记录

疑问与错题记录

日期 来源 问题或错误 原因 修正后的理解 是否解决
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